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电信技术
LDPC码的全并行概率译码
针对LDPC码和积译码算法运算量大、电路实现复杂度高,介绍一种新的LDPC译码实现结构——概率译码器。该结构结合随机运算思想,运算量大幅降低,电路布线实现压力减小,吞吐量显著提高,针对该算法的内部路由可能出现的死锁问题引入了边存储器(EM,Edge Memory)概念。在AWGN信道下,对上述方法进行了仿真验证,给出了新方案和旧算法的性能分析比较,结果显示该算法的性能相比传统LDPC译码器有近0.2 dB的性能损失,但译码复杂度得到显著降低。
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通信技术
2011年08期

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