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电信技术
高速基2FFT处理器的结构设计与FPGA实现
本文研究了采用AISC来实现高速实时基2FFT处理器的设计方案。在实现中采用了单基2定点内核,设计了防溢出控制结构,在不增加系统延时的基础上,提高了运算精度。设计了对称乒乓RAM结构,在保证蝶形运算核的占用率的条件下,提高了该FFT处理器的连续运算能力。将RAM集成在FFT处理器内部,提高了使用的灵活性。本文所设计的FFT具有可配置特性,可根据需要计算2的幂次方的FFT。256点的FFT运算只需1072个时钟周期,在VertexII-xc2v1000上综合实现,频率可达112.007MHz,完成整个256点的FFT运算仅需9.57μs。
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电路与系统学报
2005年05期
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