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64位高性能嵌入式CPU中乘法器单元的设计与实现

赵忠民

   乘法器是现代微处理器芯片中的关键部件,其主要设计思想,就是在结构复杂度和电路类型,以及速度和面积之间进行均衡。乘法运算是以大量的加法运算为基础的,完成一次乘法运算的基本步骤是:产生部分积和对部分积进行求和。本文以此为基本出发点,对Booth算法进行了研究,并对用于压缩部分积的各种加法阵列结构进行了分析和比较,结合该设计的指令集结构,提出了一种以CSA和4-2压缩器共同作为基本加法单元的混合电路结构,构建了一种独创的改进的Wallace树型结构的乘法器,它在部分积求和过程中的硬件利用率达到了最高,并有效的改进了传统Wallace树和其他结构的缺陷。最终,采用全定制的设计方法流程,在电路和版图上对基于流水线的此64位定点树型乘法器进行了设计与实现。……   
[关键词]:定点乘法器;树型结构;Booth编码;进位保留加法器;4-2压缩器;混合电路结构
[文献类型]:硕士论文
[文献出处]:同济大学2007年